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Cadence PCB 設(shè)計(jì)與制板.doc
資料評(píng)價(jià):
暫無(wú)
生成時(shí)間:
2021-08-15
下載權(quán)限:
免費(fèi)會(huì)員
文件大小:
88KB
文件類型:
.doc
瀏覽次數(shù):
2
建筑論壇:
上傳會(huì)員:
ptgir
所屬欄目:
學(xué)習(xí)資料2
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Cadence PCB 設(shè)計(jì)與制板,Cadence PCB 設(shè)計(jì)
設(shè)計(jì)與制板筆記鄭中偉表格
設(shè)計(jì)與制板筆記
沒(méi)有你的城市
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§、安裝:
~,安裝、,第為庫(kù),不安裝
安裝:
設(shè)置環(huán)境變量
修改中為
§、用設(shè)計(jì)原理圖
進(jìn)入
設(shè)置操作環(huán)境
顏色:
格子:
雜項(xiàng):
常取默認(rèn)值
配置設(shè)計(jì)圖紙:
設(shè)定模板:應(yīng)用于新圖
設(shè)定當(dāng)前圖紙
創(chuàng)建新設(shè)計(jì)
創(chuàng)建元件及元件庫(kù)
封裝下元件的個(gè)數(shù)
只有一個(gè)元件時(shí),不起作用
復(fù)合封裝元件中多個(gè)元件圖組成時(shí)每個(gè)元件圖都一樣適用于標(biāo)準(zhǔn)邏輯
復(fù)合封裝元件多個(gè)元件圖組成時(shí)中使用不一樣的元件圖較適用于大元件
一個(gè)封裝跋露喔鱸跡鄖謝皇油?br>
建立項(xiàng)目
可以多張圖:
單層次電路圖間,以相同名稱的“電路端口連接器”連接
層次式電路圖:以方塊圖層次塊來(lái)代替實(shí)際電路的電路圖,以相同名稱的配對(duì)內(nèi)層電路,內(nèi)層電路之間可以多張,同單層連接
繪制原理圖
放置元器件:
元件:來(lái)自先要添加庫(kù)
電源和地
連接線路
:與之間必須以支線連接,并以網(wǎng)標(biāo)對(duì)應(yīng),
數(shù)據(jù)總線和數(shù)據(jù)總線的引出線必須定義
修改元件序號(hào)和元件值
創(chuàng)建分級(jí)模塊多張電路圖
平坦式單層次電路:各電路之間信號(hào)連接,以相同名稱的連接
層次式電路圖:以方塊圖層次塊來(lái)代替實(shí)際電路的電路圖,以相同名稱的配對(duì)內(nèi)層電
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§、安裝:
~,安裝、,第為庫(kù),不安裝
安裝:
設(shè)置環(huán)境變量
修改中為
§、用設(shè)計(jì)原理圖
進(jìn)入
設(shè)置操作環(huán)境
顏色:
格子:
雜項(xiàng):
常取默認(rèn)值
配置設(shè)計(jì)圖紙:
設(shè)定模板:應(yīng)用于新圖
設(shè)定當(dāng)前圖紙
創(chuàng)建新設(shè)計(jì)
創(chuàng)建元件及元件庫(kù)
封裝下元件的個(gè)數(shù)
只有一個(gè)元件時(shí),不起作用
復(fù)合封裝元件中多個(gè)元件圖組成時(shí)每個(gè)元件圖都一樣適用于標(biāo)準(zhǔn)邏輯
復(fù)合封裝元件多個(gè)元件圖組成時(shí)中使用不一樣的元件圖較適用于大元件
一個(gè)封裝跋露喔鱸跡鄖謝皇油?br>
建立項(xiàng)目
可以多張圖:
單層次電路圖間,以相同名稱的“電路端口連接器”連接
層次式電路圖:以方塊圖層次塊來(lái)代替實(shí)際電路的電路圖,以相同名稱的配對(duì)內(nèi)層電路,內(nèi)層電路之間可以多張,同單層連接
繪制原理圖
放置元器件:
元件:來(lái)自先要添加庫(kù)
電源和地
連接線路
:與之間必須以支線連接,并以網(wǎng)標(biāo)對(duì)應(yīng),
數(shù)據(jù)總線和數(shù)據(jù)總線的引出線必須定義
修改元件序號(hào)和元件值
創(chuàng)建分級(jí)模塊多張電路圖
平坦式單層次電路:各電路之間信號(hào)連接,以相同名稱的連接
層次式電路圖:以方塊圖層次塊來(lái)代替實(shí)際電路的電路圖,以相同名稱的配對(duì)內(nèi)層電
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